是的，这句话的意思是说内部已经集成了偏置电路，偏置电压为CLKVDD18 / 2.AC耦合后的分压电阻的目的也是为了重新建立新的共模电压，如果内部已经偏置，那么外部就不需要了。
林海雪原
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请问DAC3161的DACCLK能否支持LVDS电平输入吗？ 通过FPGA提供时钟给DAC3161的DACCLK，但是FPGA提供的是LVDS电平，而DAC3161的DACCLK是LVPECL电平。 两者不能直接对接，可以通过AC耦合方式对接。但是查看DAC3161的数据手册，有这么一段话不太理解：LVPECL clock input for DAC core with a self-bias of approximately CLKVDD18 / 2.因为没有给出具体的框图，所以无法知晓内部的结构。是不是可以这么理解，只需要AC耦合，不需要后面的端接电阻，内部已包含了。多谢！
